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可以插入控制字符。在10bit数据可以表示的1024个组合中，除了512个组合用 于对应原始的8bit数据以及一些不太好的组合(这样信号里有太长的 连续0或者1,而且明显0、1的数量不平衡)以外，还有一些很特殊的组合。这些特殊的组 合可以用来在数据传输过程中作为控制字符插入。这些控制字符不对应特定的 8bit数据，但是在有些总线应用里可以一些特殊的含义。比如K28.5码型，其特殊的 码型组合可以帮助接收端更容易判别接收到的连续的10bit数据流的符号边界，所以在一 些总线的初始化阶段或数据包的包头都会进行发送。还有一些特殊的符号用于进行链路训 练、标记不同的数据包类型、进行收发端的时钟速率匹配等。数字信号的眼图分析（Eye Diagram Analysis）;山西多端口矩阵测试数字信号测试
数字信号的均衡(Equalization)
前面介绍了预加重或者去加重技术对于克服传输通道损耗、改善高速数字信号接收端信号质量的作用，但是当信号速率进一步提高或者传输距离更长时，**在发送端已不能充分补偿传输通道带来的损耗，这时就需要在接收端同时使用均衡技术来进一步改善信号质量。所谓均衡，是在数字信号的接收端进行的一种补偿高频损耗的技术。常见的信号均衡技术有3种：CTLE(ContinuousTimeLinearEqualization)、FFE(FeedForwardEqualization)和DFE(DecisionFeedbackEqualization).CTLE是在接收端提供一个高通滤波器，这个高通滤波器可以对信号中的主要高频分量进行放大，这一点和发送端的预加重技术带来的效果是类似的。有些速率比较高的总线，为了适应不同链路长度损耗的影响，还支持多挡不同增益的CTLE均衡器。图1.35是PCle5.0总线在接收端使用的CTLE均衡器的频响曲线的例子。 河南数字信号测试执行标准波形参数测试室数字信号测试常用的测量方法，随着数字信号速率的提高，波形参数的测量方法越来越不适用了。
为了保证接收端在时钟有效沿时采集到正确的数据，通常都有建立/保持时间的要求，以避免采到数据线上跳变时不稳定的状态，因此这种总线对于时钟和数据线间走线长度的差异都有严格要求。这种并行总线在使用中比较大的挑战是当总线时钟速率超过几百MHz后就很难再提高了，因为其很多根并行线很难满图1.15并行总线的时钟传输足此时苛刻的走线等长的要求，特别是当总线上同时挂有多个设备时。为了解决并行总线工作时钟频率很难提高的问题，一些系统和芯片的设计厂商提出了嵌入式时钟的概念。其思路首先是把原来很多根的并行线用一对或多对高速差分线来代替，节省了布线空间；然后把系统的时钟信息通过数据编码的方式嵌在数据流里，省去了专门的时钟走线。信号到了接收端，接收端采用相应的CDR(clock-datarecovery)电路把数据流中内嵌的时钟信息提取出来再对数据采样。图1.16是一个采用嵌入式时钟的总线例子。
要把并行的信号通过串行总线传输，一般需要对数据进行并/串转换。为了进一步减少传输线的数量和提高传输距离，很多高速数据总线采用嵌入式时钟和8b/10b的数据编码方式。8b/10b编码由于直流平衡、支持AC耦合、可嵌入时钟信息、抗共模干扰能力强、编解码结构相对简单等优点，在很多高速的数字总线如FiberChannel、PCIe、SATA、USB3.0、DisplayPort、XAUI、RapidIO等接口上得到广泛应用。图1.20是一路串行的2.5Gbps的8b/10b编码后的数据流以及相应的解码结果，从中可以明显看到解出的K28.5等控制码以及相应的数据信息。模拟信号和数字信号之间的区别吗？
对于真实的数据信号来说，其频谱会更加复杂一些。比如伪随机序列(PRBS)码流的频谱的包络类似一个sinc函数。图1.4是用同一个发送芯片分别产生的800Mbps和2.5Gbps的PRBS信号的频谱，可以看到虽然输出数据速率不一样，但是信号的主要频谱能量集中在4GHz以内，也并不见得2.5Gbps信号的高频能量就比800Mbps的高很多。
频谱仪是对信号能量的频率分布进行分析的准确的工具，数字工程师可以借助频谱分析仪对被测数字信号的频谱分布进行分析。当没有频谱仪可用时，我们通常根据数字信号的上升时间估算被测信号的频谱能量：
信号的比较高频率成分=0.5/信号上升时间(10%～90%)
或者当使用20%～80%的上升时间标准时，计算公式如下：
信号的比较高频率成分=0.4/信号上升时间(20%～80%) 数字此案好的上升时间（Rising Time）;DDR测试数字信号测试工厂直销
数字信号是指用一组特殊的状态来描述信号；山西多端口矩阵测试数字信号测试
数字信号的抖动(Jitter)
抖动的概念
抖动(Jitter)是数字信号，尤其是高速数字信号的一个非常关键的概念。如图1.40所 示，抖动反映的是数字信号偏离其理想位置的时间偏差。
高频数字信号的比特周期都非常短，一般为几百ps甚至几十ps,很小的抖动都会造成信号采样位置的变化从而造成数据误判，所以高频数字信号对于抖动都有严格的要求。抖动这个概念说起来简单，但实际上仔细研究起来是非常复杂的，关于其概念的理解有以下几个需要注意的方面：
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