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时间:2023年07月04日 来源:

数字信号并行总线与串行总线(Parallel and Serial Bus)

虽然随着技术的发展,现代的数字芯片已经集成了越来越多的功能,但是对于稍微复杂  一点的系统来说,很多时候单独一个芯片很难完成所有的工作,这就需要和其他芯片配合起  来工作。比如现在的CPU的处理能力越来越强,很多CPU内部甚至集成了显示处理的功  能,但是仍然需要配合外部的内存芯片来存储临时的数据,需要配合桥接芯片扩展硬盘、 USB等接口;现代的FPGA内部也可以集成CPU、DSP、RAM、高速收发器等,但有些  场合可能还需要配合用的DSP来进一步提高浮点处理效率,配合额外的内存芯片来扩展  存储空间,配合用的物理层芯片来扩展网口、USB等,或者需要多片FPGA互连来提高处  理能力。所有这一切,都需要用到相应的总线来实现多个数字芯片间的互连。如果我们把  各个功能芯片想象成人体的各个功能,总线就是血脉和经络,通过这些路径,各个功能  模块间才能进行有效的数据交换和协同工作。 什么是模拟信号和数字信号是什么。上海数字信号测试USB测试

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简单的预加重对信号的频谱改善并不是完美的,比如其频率响应曲线并不一定与实际 的传输通道的损耗曲线相匹配,所以高速率总线会采用阶数更高、更复杂的预加重技术。 图1.28所示是一个3阶的预加重,其除了对跳变沿后面的第1个比特进行预加重处理外,跳变沿 之后的第2个比特的幅度也有变化。跳变沿后第1个比特的幅度变化有时也叫Post Cursorl,

跳变沿后的第2个比特的幅度变化有时也叫Post Cursor2。有些总线如PCIe3.0,会对跳变 沿前面的1个比特的幅度也进行调整,叫作Pre Cursor1,有时也称为PreShoot。 电气性能测试数字信号测试厂家现货数字信号的预加重(Pre-emphasis);

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简单的去加重实现方法是把输出信号延时一个或多个比特后乘以一个加权系数并和 原信号相加。一个实现4阶去加重的简单原理图。

去加重方法实际上压缩了信号直流电平的幅度,去加重的比例越大,信号直流电平被压缩得越厉害,因此去加重的幅度在实际应用中一般很少超过-9.5dB。做完预加重或者去加重的信号,如果在信号的发送端(TX)直接观察,并不是理想的眼图。图1.31所示是在发送端看到的一个带-3.5dB预加重的10Gbps的信号眼图,从中可以看到有明显的“双眼皮”现象。

对于并行总线来说,更致命的是这种总线上通常挂有多个设备,且读写共用,各种信号分叉造成的反射问题使得信号质量进一步恶化。

为了解决并行总线占用尺寸过大且对布线等长要求过于苛刻的问题,随着芯片技术的发展和速度的提升,越来越多的数字接口开始采用串行总线。所谓串行总线,就是并行的数据在总线上不再是并行地传输,而是时分复用在一根或几根线上传输。比如在并行总线上 传输1Byte的数据宽度需要8根线,而如果把这8根线上的信号时分复用在一根线上就可 以减少需要的走线数量,同时也不需要再考虑8根线之间的等长关系。 数字信号的眼图分析(Eye Diagram Analysis);

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建立时间和保持时间加起来的时间称为建立/保持时间窗口,是接收端对于信号保持在 同一个逻辑状态的**小的时间要求。数字信号的比特宽度如果窄于这个时间窗口就肯定无 法同时满足建立时间和保持时间的要求,所以接收端对于建立/保持时间窗口大小的要求实 际上决定了这个电路能够工作的比较高的数据速率。通常工 作速率高一些的芯片,很短的建 立时间、保持时间就可以保证电路可靠工作,而工作速率低一 些的芯片则会要求比较长的建 立时间和保持时间。

另外要注意的是, 一个数字电路能够可靠工作的比较高数据速率不仅取决于接收端对于 建立/保持时间的要求,输出端的上升时间过缓、输出幅度偏小、信号和时钟中有抖动、信号 有畸变等很多因素都会消耗信号建立/保持时间的裕量。因此一个数字电路能够达到的比较高数据传输速率与发送芯片、接收芯片以及传输路径都有关系。

建立时间和保持时间是数字电路非常重要的概念,是接收端可靠信号接收的**基本要 求,也是数字电路可靠工作的基础。可以说,大部分数字信号的测量项目如数据速率、信号 幅度、眼图、抖动等的测量都是为了间接保证信号满足接收端对建立时间和保持时间的要 求,在以后章节的论述中我们可以慢慢体会。 数字信号处理系统的性能取决于3个因素:采样频率、架构、字长。电气性能测试数字信号测试厂家现货

上升时间是数字信号另一个非常关键的参数,它反映了一个数字信号在电平切换时边沿变化的快慢。上海数字信号测试USB测试

对于一个理想的方波信号,其上升沿是无限陡的,从频域上看 它是由无限多的奇数次谐波构成的,因此一个理想方波可以认为是无限多奇次正弦谐波 的叠加。

但是对于真实的数字信号来说,其上升沿不是无限陡的,因此其高次谐波的能量会受到 限制。比如图1.3是用同一个时钟芯片分别产生的50MHz和250MHz的时钟信号的频 谱,我们可以看到虽然两种情况下输出时钟频率不一样,但是信号的主要频谱能量都集中在 5GHz以内,并不见得250MHz时钟的频谱分布就一定比50MHz时钟的大5倍。 上海数字信号测试USB测试

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